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GAL6002
High Performance E2CMOS FPLA Generic Array Logic
品質保證
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認證
我們已成功獲得各項認證標準，並建立了自己的專業檢測實驗室。 這確保了我們向客戶提供的每件產品都符合最高的品質標準。 我們遵守嚴格的測試協議，以保持我們產品的一致性和準確性。 為了確保我們的產品是原裝正品，我們還與信譽良好的第三方檢測機構合作進行嚴格的品質測試。 我們對品質的承諾延伸到滿足行業、法律、監管和 ISO 9001:2015 的要求。
運輸與付款
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服務與包裝
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在包裝方面，我們的產品均精心包裝在防靜電袋中，以提供ESD防靜電保護。 外包裝堅固耐用且閉合牢固。 我們支持各種包裝方法，例如捲帶式、切帶式、管式或託盤式。
例子
捲帶式
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GAL6002 數據表
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詳細說明
Having an FPLA architecture, the GAL6002 provides superior flexibility in state-machine design. The GAL6002 offers the highest degree of functional integration, flexibility, and speed currently available in a 24-pin, 300-mil package. E2CMOS technology offers high speed (<100ms) erase times, providing the ability to reprogram or reconfigure the device quickly and efficiently.Features• HIGH PERFORMANCE E2CMOS® TECHNOLOGY — 15ns Maximum Propagation Delay — 75MHz Maximum Frequency — 6.5ns Maximum Clock to Output Delay — TTL Compatible 16mA Outputs — UltraMOS® Advanced CMOS Technology• ACTIVE PULL-UPS ON ALL PINS• LOW POWER CMOS — 90mA Typical Icc• E2 CELL TECHNOLOGY — Reconfigurable Logic — Reprogrammable Cells — 100% Tested/100% Yields — High Speed Electrical Erasure (<100ms) — 20 Year Data Retention• UNPRECEDENTED FUNCTIONAL DENSITY — 78 x 64 x 36 FPLA Architecture — 10 Output Logic Macrocells — 8 Buried Logic Macrocells — 20 Input and I/O Logic Macrocells• HIGH-LEVEL DESIGN FLEXIBILITY — Asynchronous or Synchronous Clocking — Separate State Register and Input Clock Pins — Functional Superset of Existing 24-pin PAL® and FPLA Devices• APPLICATIONS INCLUDE: — Sequencers — State Machine Control — Multiple PLD Device Integration
主要特徵
- HIGH PERFORMANCE E2CMOS® TECHNOLOGY
- — 15ns Maximum Propagation Delay
- — 75MHz Maximum Frequency
- — 6.5ns Maximum Clock to Output Delay
- — TTL Compatible 16mA Outputs
- — UltraMOS® Advanced CMOS Technology
- ACTIVE PULL-UPS ON ALL PINS
- LOW POWER CMOS
- — 90mA Typical Icc
- E2 CELL TECHNOLOGY
- — Reconfigurable Logic
- — Reprogrammable Cells
- — 100% Tested/100% Yields
- — High Speed Electrical Erasure (<100ms)
- — 20 Year Data Retention
- UNPRECEDENTED FUNCTIONAL DENSITY
- — 78 x 64 x 36 FPLA Architecture
- — 10 Output Logic Macrocells
- — 8 Buried Logic Macrocells
- — 20 Input and I/O Logic Macrocells
- HIGH-LEVEL DESIGN FLEXIBILITY
- — Asynchronous or Synchronous Clocking
- — Separate State Register and Input Clock Pins
- — Functional Superset of Existing 24-pin PAL®
- and FPLA Devices
- APPLICATIONS INCLUDE:
- — Sequencers
- — State Machine Control
- — Multiple PLD Device Integration
數據表 PDF
數據表記錄了器件的特性、絕對最大額定值、應用等，這對於作為器件特定應用的整體指南大有裨益。
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