MC100LVEP14
5-output differential ECL/PECL/HSTL clock/data buffer for 2.5V/3.3VMC100LVEP14
5-output differential ECL/PECL/HSTL clock/data buffer for 2.5V/3.3V
品質保證
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運輸與付款
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服務與包裝
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例子
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MC100LVEP14 數據表
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詳細說明
The MC100LVEP14 is a low skew 1 to 5 differential driver, designed with clock distribution in mind, accepting two clock sources into an input multiplexer. The ECL/PECL input signals can be either differential or single-ended (if the VBB output is used). HSTL inputs can be used when the LVEP14 is operating under PECL conditions.
主要特徵
- Operating Range: 3.0V to 5.5V
- Differential LVPECL Inputs and Outputs
- High-speed: Supports up to 3.8GHz clock frequencies
- Low skew: Maximum output-to-output skew of 50ps
- Wide supply voltage range
- Available in 8-pin SOIC package
應用
- Data communication systems
- Networking equipment
- Fiber optic communication systems
- Microwave communication systems
- Satellite communication systems
- Radar systems
- High-speed data acquisition systems
- Test and measurement equipment
- Instrumentation
- Signal processing applications
Specification Comparison
數據表 PDF
數據表記錄了器件的特性、絕對最大額定值、應用等,這對於作為器件特定應用的整體指南大有裨益。
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