CY7C131-55JC
Advanced CMOS technology ensures excellent noise immunity and high performance in harsh environmentCY7C131-55JC
Advanced CMOS technology ensures excellent noise immunity and high performance in harsh environment
品質保證
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運輸與付款
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服務與包裝
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CY7C131-55JC 數據表
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詳細說明
Functional Description The CY7C130/CY7C131/CY7C140 and CY7C141 are high-speed CMOS 1K by 8 dual-port static RAMs. Two ports are provided permitting independent access to any location in memory. The CY7C130/ CY7C131 can be utilized as either a standalone 8-bit dual-port static RAM or as a master dual-port RAM in conjunction with the CY7C140/CY7C141 slave dual-port device in systems requiring 16-bit or greater word widths. It is the solution to applications requiring shared or buffered data, such as cache memory for DSP, bit-slice, or multiprocessor designs.Features • True Dual-Ported memory cells which allow simultaneous reads of the same memory location • 1K x 8 organization • 0.65-micron CMOS for optimum speed/power • High-speed access: 15 ns • Low operating power: ICC = 110 mA (max.) • Fully asynchronous operation • Automatic power-down • Master CY7C130/CY7C131 easily expands data bus width to 16 or more bits using slave CY7C140/CY7C141 • BUSY output flag on CY7C130/CY7C131; BUSY input on CY7C140/CY7C141 • INT flag for port-to-port communication • Available in 48-pin DIP (CY7C130/140), 52-pin PLCC, 52-Pin TQFP. • Pb-Free packages available
主要特徵
- True Dual-Ported memory cells which allow simultaneous reads of the same memory location
- 1K x 8 organization
- 0.65-micron CMOS for optimum speed/power
- High-speed access: 15 ns
- Low operating power: ICC = 110 mA (max.)
- Fully asynchronous operation
- Automatic power-down
- Master CY7C130/CY7C131 easily expands data bus width to 16 or more bits using slave CY7C140/CY7C141
- BUSY output flag on CY7C130/CY7C131; BUSY input on CY7C140/CY7C141
- INT flag for port-to-port communication
- Available in 48-pin DIP (CY7C130/140), 52-pin PLCC, 52-Pin TQFP.
- Pb-Free packages available
規格
以下是所選零件的基本參數,涉及零件的特性及其所屬類別。
Rohs Code | No | Part Life Cycle Code | Obsolete |
Part Package Code | LCC | Pin Count ! | 52 |
Reach Compliance Code | not_compliant | ECCN Code | EAR99 |
HTS Code ! | 8542.32.00.41 | Access Time-Max | 55 ns |
Additional Feature ! | INTERRUPT FLAG | I/O Type | COMMON |
JESD-30 Code | S-PQCC-J52 | JESD-609 Code | e0 |
Length | 19.1262 mm | Memory Density | 8192 bit |
Memory IC Type | MULTI-PORT SRAM | Memory Width | 8 |
Moisture Sensitivity Level | 3 | Number of Functions | 1 |
Number of Ports ! | 2 | Number of Terminals | 52 |
Number of Words | 1024 words | Number of Words Code | 1000 |
Operating Mode ! | ASYNCHRONOUS | Operating Temperature-Max | 70 °C |
Operating Temperature-Min | Organization | 1KX8 | |
Output Characteristics | 3-STATE | Output Enable | YES |
Package Body Material | PLASTIC/EPOXY | Package Code | QCCJ |
Package Equivalence Code | LDCC52,.8SQ | Package Shape | SQUARE |
Package Style | CHIP CARRIER | Parallel/Serial | PARALLEL |
Power Supplies ! | 5 V | Qualification Status ! | Not Qualified |
Seated Height-Max | 5.08 mm | Standby Current-Max | 0.015 A |
Standby Voltage-Min | 4.5 V | Supply Current-Max | 0.11 mA |
Supply Voltage-Max (Vsup) | 5.5 V | Supply Voltage-Min (Vsup) | 4.5 V |
Supply Voltage-Nom (Vsup) | 5 V | Surface Mount ! | YES |
Technology | CMOS | Temperature Grade ! | COMMERCIAL |
Terminal Finish | TIN LEAD | Terminal Form ! | J BEND |
Terminal Pitch ! | 1.27 mm | Terminal Position | QUAD |
Width | 19.1262 mm |
Specification Comparison
數據表 PDF
數據表記錄了器件的特性、絕對最大額定值、應用等,這對於作為器件特定應用的整體指南大有裨益。
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